0.4-2㎓, Seamless 주파수 트래킹 제어 이중 루프 디지털 PLL

이 논문은 seamless 주파수 트래킹 방법을 이용한 새로운 이중 루프 디지털 PLL(DPLL)을 제안한다. Coarse 루프와 fine 루프로 구성되는 이중 루프 구조는 빠른 획득 시간과 스위칭 잡음 억제를 위하여 successive approximation register기법과 TDC 회로를 사용하였다. 제안된 DPLL은 입력 주파수의 long-term 지터에 따른 지터 특성을 보상하기 위하여 Coarse와 fine의 코드 변환 주파수 트래킹 방법을 새로이 추가하였다. 또한, 제안된 DPLL은 넓은 주파수 동작 범위와 낮은 지터 특성 위하여 전류 제어 발진기와 V-I 변환기로 구성되는 전압제어 발진기를 채택하였다. 제안된 DPLL은 동부 하이텍 0.18-㎛ CMOS 공정으로 구현하였으며 1.8V의 공급전압에서 0.4-2㎓의 넓은 동작 주파수 범위와 0.18㎟의 적은 면적을 가진다. H-SPICE 시뮬레이션을 통하여, DPLL은 2㎓의 동작 주파수에서 18㎽ 파워소비와 전원잡음이 없는 경우 3psec이하의 p-p period 지터를 확인하였다.