Programmable logic device configuration

本发明为一种适于数据通路应用的可编程逻辑器件(FDP)，由可编程逻辑单元(LC)阵列组成，通过层次式的可编程连线资源组织成为层次式结构。 其中，将m×n个(16≥m，n≥2)LC组成可编程宏单元(MC)，以利于实现多位的数据运算；以MC为基本单元进行阵列扩展，获得不同规格的FPGA系列，也可以得到满足不同逻辑容量要求的可编程IP核。 FDP结构既可以作为FPGA芯片，也可以作为可编程片上系统或者可编程IP核。