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MATLABに基づく並列ループ冗長性検査のためのVERILOGコードの自動生成方法を提案した。【JST・京大機械翻訳】
MATLABに基づく並列ループ冗長性検査のためのVERILOGコードの自動生成方法を提案した。【JST・京大機械翻訳】
2016
Xue Jun
Duan Fajie
Jiang Jiajia
Li Yanchao
Yuan Jianfu
Wang Xianquan
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